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立即發案

王珩

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接案身分: 個人兼職

上線時間: 3天前

接案地點: 皆可

成交件數: 1

受邀次數: 41

專長: # IC邏輯電路設計 # 硬體程式設計 # 日文翻譯

關於

清大電機(2012畢)學士,台大電機(2014畢)碩士。
旅日(2016~2019)工程師(日檢N1有)。
目前(2020.03~)活動於台灣(台中)。
歡迎各界案主洽談。

專營FPGA Verilog/VHDL程式撰寫。
免費日文翻譯/顧問/輔導。

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